ei811fABB

ei811f
ei811f 在设计的初级阶段，可以不加I/O约束，让工具专注于满足FPGA内部的时序要求。当时序要求基本满足后，再加上I/O约束跑实现。XDC中的I/O约束有以下几点需要注意：

不加任何I/O约束的端口时序要求被视作无穷大。

XDC中的set_input_delay / set_output_delay对应于UCF中OFFSET IN / OFFSET OUT，但视角相反。OFFSET IN / OFFSET OUT是从FPGA内部延时的角度来约束端口时序，set_input_delay / set_output_delay则是从系统角度来约束。

典型的I/O时序，包括系统同步、源同步、SDR和DDR等等，在Vivado图形界面的XDC templates中都有示例。2014.1版后还有一个TIming Constraints Wizard可供使用。

时序例外约束

时序例外约束包括set_max_delay/set_min_delay，set_mulTIcycle_path，set_false_path等，这类约束除了要满足XDC的先后顺序级外，还受到自身级的限制。一个总的原则就是针对同一条路径，对约束目标描述越具体的级越高。不同的时序例外约束以及同一约束中不同条件的级
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