CM572-DP

CM572-DP 内嵌ARM核心的FPGA倾巢出

SoC FPGA并不是新产品，这类结合硬式核心(Hard-core)处理系统和可程序逻辑的产品，早就用在除了处理器和周边之外，另须外加逻辑的应用中。它的可程序逻辑可用来进行大量运算或讯号处理，以提升系统整体效能；此外，这类产品亦可做为许多应用的单芯片解决方案。

过去这类产品的硬式核心处理器多采用PowerPC核心，不过随着安谋国际核心的普及，目前已有三家厂商推出内嵌安谋国际核心的FPGA，其中美高森美(Microsemi)的SmartFusion内嵌应用广泛的Cortex-M3硬式核心微控制器(MCU)，而Altera的Cyclone V和Arria V系列，以及赛灵思的Zynq-7000系列都选择内嵌更能的双核心Cortex-A9处理器。
CM572-DP PS处理系统是如同ASIC一般的固定硬件(Hard-wired)，相当于一个内嵌于FPGA中既定架构的安谋国际处理系统，其包含双核心、频率可达800MHz的Cortex-A9处理器，及固定硬件的双倍数据率(DDR)和闪存控制器；此外，固定硬件的部分还包含以太网络(Ethernet)、第二代通用串行总线(USB)2.0、控制器局域网络(CAN)、安全数字输入/输出(SDIO)、内部整合电路(I2C)、串行周边接口(SPI)、通用异步收发器(UART)和通用输入/输出(GPIO)等常见的嵌入式系统周边。

Zynq-7000系列产品都内嵌一样的安谋国际处理系统，但是PL可程序逻辑的大小则各有不同。两个较大的产品容量分别相当于一百九十万和三百五十万个ASIC逻辑闸，而两个较小的产品容量分别相当于四十三万和一百三十万个ASIC逻辑闸。

连接PS和PL的是AXI接口。安谋国际所制定的AMBA接口是SoC On-chip Bus的实际标准，它已为满足芯片容量增加随之而来的效能需求修订好几版，新的规格就是AXI(Advanced eXtensible Interface)。

由此可知，Zynq FPGA即包含处理器核心和可程序逻辑，且使用和ASIC同样的AXI接口连接，很明显地它可以用作SoC原型制作，因此使用Zynq即能建构一个支持Cortex-A9设计的原型制作平台。
CM572-DP Zynq连接PS和PL的AXI接口有好几种，各有不同的特性，因此当你决定要用Zynq做为原型制作平台时，马上就面临一个问题：在这几种AXI接口之中，究竟要用哪个来做为处理器和SoC其他部分连接的原型？PL中的逻辑要跟哪个AXI接口连接才能接到处理器，而不只是接到处理系统的内存控制器和周边？

连接PS和PL的有三种AXI接口：通用(General-purpose)、能(High-performance)和加速器一致性端口(Accelerator Coherency Port, ACP)。对PS而言，有两个到PL的通用Master AXI接口和两个从PL来的通用Slave AXI接口。Master在这里指的是数据传输的发起者，而Slave只能响应数据传输的要求。PS的Master AXI接口一般是用来对PL中的周边做传输，而Slave AXI接口则用来响应PL的要求。此外，还有四个能(64位宽度)的AXI接口，这四个接口对PS来说都是Slave，且都接到PS里的内存控制器，用来让PL里的Master存取内存。后，ACP则是另一个从PL到PS的32位Slave AXI接口。

因此，若要用安谋国际处理器做为Master连接PL，用那两个通用Master AXI接口。这两个接口均相同，因此使用任一个皆可。 公司的理念是帮助您！


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